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  • [IC設計] Asynchronous FIFO,使用非同步FIFO解決bus CDC(Crossing clock domain)問題
    2025-06-13

    [IC設計] Asynchronous FIFO,使用非同步FIFO解決bus CDC(Crossing clock domain)問題

    如上圖 interface 可切分為左半邊 write 端 右半邊的 read 端 最主要儲存資料的 FIFO…

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  • [IC設計] 何謂Metastability? 使用clock domain crossing (CDC)的幾種方法
    2025-06-13

    [IC設計] 何謂Metastability? 使用clock domain crossing (CDC)的幾種方法

    本文移植於tutortecho 2019年12月13日 撰寫 網路上有非常多討論 meta stable 的文…

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  • 2025-06-13

    [IC驗證] 建立電路的 C model 作為驗證對照組

    本文移植於tutortecho 2019年11月27日 撰寫 在業界進行IC產品開發時 通常會有一部分的人負責…

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  • 2025-06-13

    [IC設計] 使用 Mux synchronizer (Qualifier)解決 bus 跨 clock domain crossing(CDC)的問題

    本文移植於tutortecho 2019年12月16日 撰寫 在 cdc 的問題中 有的時候我們可能需要將一條…

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  • 2025-06-13

    [IC設計] 如何使用 Altera Quartus II + ModelSim 進行電路模擬開發

    本文移植於tutortecho 2019年12月14日 撰寫 Quartus 版本 : Quartus Pri…

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  • 2025-06-13

    [IC設計] sram read/write interface (讀寫介面)說明

    本文移植於tutortecho 2019年12月14日 撰寫 在 IC design 的世界中勢必會使用到大量…

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  • 2025-06-13

    [IC設計] 利用 Don’t touch cell 結合 Gated-clk 讓 Memory (Sram, Rom) idle 時更省電

    本文移植於tutortecho 2019年12月14日 撰寫 下圖是一個使用 AXI protocal來存取 …

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  • 2025-06-13

    [IC設計] 在電路中加上 power monitor

    本文移植於tutortecho 2019年12月15日 撰寫 在硬體底層的運作中 如果我們要對一些特殊演算法的…

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  • 2025-06-13

    [IC設計] SRAM 的分類,1 port、2 port、dual port、register file

    本文移植於tutortecho 2019年12月15日 撰寫 在 memory compiler 中 可以透過…

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  • 2025-06-13

    [Computer organization] Static multiple issue and register renaming

    本文移植於tutortecho 2021年6月20日 撰寫 (本文章以本人學習筆記為主, 中英夾雜沒有期待有人…

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